ARM嵌入式系统软件编程实战经验

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     A R M 系列处理惩罚器是R I S C（R e d u c d e d I n s t r u c t I o n S e tComputing）处理惩罚器。很多基于ARM的高效代码的步伐计划战略都源于RIS C处理惩罚器。和很多R I S C处理惩罚器一样，A R M系列处理惩罚器的内存访问，也请求数据对齐，即存取“字（Wo rd）”数据时请求四字节对齐，地点的b I t s[1:0]＝＝0b00；存取“半字（Half words）”时请求两字节对齐，地点的bit[0]＝＝0b0；存取“字节Byte）”数据时请求该数据按其天然尺寸边界（Natural Size Boundary）定位。

     A R M编译步伐通常将全局变量对齐到天然尺寸边界上，以便通过利用L D R和S T R指令有效地存取这些变量。这种内存访问方法与多数C I S C（C o m p l e xInstruction Set Computing）体系布局差别，在CISC体系布局下，指令直接存取未对齐的数据。因而，当必要将代码从CISC体系布局向 A R M 处理惩罚器移植时，内存访问的地点对齐题目必须予以细致。在R I S C体系布局下，存取未对齐数据无论在代码尺寸或是步伐实行服从上，都将付出非常大的价格。

    本文将从以下几个方面讨论在A R M体系布局下的步伐计划题目。

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